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FPGA中用verilog编写的模块和用SOPC搭建的nios软核都用到了SDRAM，请问怎么协调使用呢？
FPGA中用verilog编写的模块和用SOPC搭建的nios软核都用到了SDRAM，请问怎么协调使用呢？
2025-03-06 23:26:39
推荐回答（2个）
回答1：
引脚名字要取一样的，在FPGA内部可以通过判断寄存器来区分，要是定义成两种名字肯定报错啊！
回答2：
FPGA一般内部又空间，如果不够用了就需要用外部SDram
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